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        1、培訓(xùn)過(guò)程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽(tīng)；
        2、課程完成后,授課老師留給學(xué)員手機(jī)和Email,保障培訓(xùn)效果,免費(fèi)提供半年的技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。

集成電路IC后端設(shè)計(jì)培訓(xùn)大綱

第一階段

計(jì)算機(jī)操作系統(tǒng)UNIX應(yīng)用基礎(chǔ)；
半導(dǎo)體器件原理及集成電路概論；
集成電路設(shè)計(jì)導(dǎo)論及流程；
版圖設(shè)計(jì)工具及使用方法；
項(xiàng)目設(shè)計(jì)實(shí)踐（C）。

CMOS集成電路設(shè)計(jì)原理；
ASIC設(shè)計(jì)導(dǎo)論；
IC布局布線(xiàn)設(shè)計(jì)；
可測(cè)性設(shè)計(jì)；
項(xiàng)目設(shè)計(jì)實(shí)踐。

Synopsys DC（Design Compiler） 綜合

1，綜合的概念　
2，綜合庫(kù)與工具介紹
3，工作環(huán)境的設(shè)立和關(guān)鍵命令
4，綜合前的準(zhǔn)備工作　
5，芯片邏輯代碼和流片廠庫(kù)的結(jié)合
6，綜合的過(guò)程　
7， 綜合后網(wǎng)表的導(dǎo)出
8，時(shí)序SDC的導(dǎo)出
9，Synopsys DC 為Cadence Encounter工具所做的準(zhǔn)備工作。
10，快速綜合TCL腳本使用技巧

Cadence Encounter 布局布線(xiàn)

1.網(wǎng)表和工程庫(kù)的結(jié)合
2，環(huán)境變量的設(shè)置和關(guān)鍵命令
3,布局布線(xiàn)前的準(zhǔn)備工作
4，Synopsys DC工具和Cadence Encounter工具的銜接和配合
2.Floor plan
3.電源規(guī)劃
4.布局、擺放
5.時(shí)鐘樹(shù)
6.布線(xiàn)

Cadence Virtuos 芯片焊盤(pán)和封裝

1，環(huán)境變量的設(shè)置和關(guān)鍵命令
2，庫(kù)的導(dǎo)入
3，快速建立工作環(huán)境的方法
4，焊盤(pán)庫(kù)和工藝庫(kù)的建立
5，Encounter def文件的導(dǎo)入
6，Encounter和Virtuoso的配合
7，芯片文件的導(dǎo)入
8，焊盤(pán)和封裝的仿真
9，焊盤(pán)、封裝與芯片的管腳規(guī)劃
10，連線(xiàn)技巧

Synopsys PT（PrimeTime） 驗(yàn)證仿真

1，環(huán)境變量的設(shè)置
2，關(guān)鍵命令
3，仿真驗(yàn)證過(guò)程
4，仿真驗(yàn)證報(bào)告的產(chǎn)生
5，快速驗(yàn)證技巧
6，TCL腳本的使用技巧

第二階段

1.Floor plan
2.電源規(guī)劃
3.布局、擺放
4.時(shí)鐘樹(shù)
5.布線(xiàn)
6.RC extraction
7.靜態(tài)時(shí)序分析（STA）
8.驗(yàn)證
1)DRC
2)lvs
3)erc
9.項(xiàng)目實(shí)戰(zhàn)
10.數(shù)字后端全流程設(shè)計(jì)工具
11.相關(guān)工藝庫(kù)文件

第三階段 芯片后端全工具鏈、全流程實(shí)戰(zhàn)演練