| 數(shù)字集成電路前端設(shè)計培訓(xùn)班 |
 課程目標(biāo) |
通過本課程的學(xué)習(xí)，使學(xué)員在掌握數(shù)字集成電路設(shè)計的基本要領(lǐng)，熟悉操作系統(tǒng)和硬件描述語言HDL,熟練使用邏輯綜合仿真工具和仿真工具，并學(xué)會IC設(shè)計公司的團隊分工與合作，相當(dāng)于一年以上的數(shù)字電路設(shè)計水平和經(jīng)驗。
以SOC芯片設(shè)計流程為主線，按照不同崗位的人才技能需求，提供完整的SOC芯片設(shè)計的項目，采用公司化的項目管理方法，由工程經(jīng)驗豐富的工程師和項目經(jīng)理授課并指導(dǎo)，幫助學(xué)員快速、高效掌握SOC芯片設(shè)計流程，根據(jù)職業(yè)目標(biāo)，重點掌握核心工作技能，積累實際項目經(jīng)驗，能夠更好的勝任SOC芯片設(shè)計工程師的職位。 |
| 課程特色 |
| 本課程以工程師職業(yè)技能需求為導(dǎo)向，以積累項目經(jīng)驗為關(guān)鍵，以集成電路項目為核心，曙海培訓(xùn)發(fā)展出一套完整的集成電路工程師培訓(xùn)體系，配合項目經(jīng)驗豐富的工程師的理論授課和項目指導(dǎo)，可以幫助學(xué)員快速、高效的掌握集成電路設(shè)計工程師需要的職業(yè)技能，勝任SOC系統(tǒng)設(shè)計工程師、IC設(shè)計工程師、IC驗證工程師、DFT工程師、前端設(shè)計工程師（邏輯綜合、形式驗證、時序分析）、物理設(shè)計工程、版圖設(shè)計工程師、FPGA/ASIC/SOC工程師等職位。 |
| 課程優(yōu)勢 |
| 本課程采用公司化的項目管理方法以及主流的集成電路設(shè)計EDA工具，依據(jù)芯片設(shè)計流程的崗位需求，重點培養(yǎng)設(shè)計、驗證、DFT、物理設(shè)計、時序分析、形式驗證、CAD流程、后端版圖等工作技能。項目實訓(xùn)借助互聯(lián)網(wǎng)，學(xué)員可以收看講師在線視頻直播，及時交流互動。曙海免費贈送授課過程中用到安裝了所有工具的虛擬機，您只要打開虛擬機，隨時隨地可以完成老師布置的項目任務(wù)，通過項目實踐練習(xí)，積累項目經(jīng)驗。為每位學(xué)員安排專屬助教，幫助學(xué)員及時解決培訓(xùn)過程中遇到的問題。 |
| 培養(yǎng)對象 |
1.理工科背景，有志于數(shù)字集成電路設(shè)計工作的學(xué)生和轉(zhuǎn)行人員；
2.需要充電，提升技術(shù)水平和熟悉設(shè)計流程的在職人員；
3.集成電路設(shè)計企業(yè)的員工內(nèi)訓(xùn)。
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| 入學(xué)要求 |
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學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識：
◆電路系統(tǒng)的基本概念。 |
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| 質(zhì)量保證及就業(yè)服務(wù) |
完善的在線職業(yè)技能培訓(xùn)方案，專屬助教一對一服務(wù)，這些措施可以確保每位學(xué)員可以快速、高效的獲得芯片設(shè)計技能，積累項目經(jīng)驗，增加入職機會。12年積累，2000多家就業(yè)合作單位，可以把學(xué)員向企業(yè)內(nèi)部推薦，為學(xué)員求職開辟綠色通道。
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| 遠程授課 |
為滿足學(xué)員由于時間、地域的限制而無法參加曙海的培訓(xùn)，曙海網(wǎng)校遠程培訓(xùn)應(yīng)運而生，曙海的遠程培訓(xùn)通過專門的遠程上課軟件，能和授課工程師實時互動，能達到和面授一樣的效果。
曙海授課老師會免費提供技術(shù)支持，解答學(xué)員疑惑。
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上課時間和地點 |
| 近開課時間： 數(shù)字集成電路前端：2025年7月14日..用心服務(wù)......--即將開課--........................(歡迎您垂詢，視教育質(zhì)量為生命！) |
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實驗設(shè)備 |
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◆課時： 共3個月（每晚9:00到10:00，不影響正常工作）
☆在線遠程直播授課
☆注重質(zhì)量
☆邊講邊練
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| 師資團隊 |
【趙老師】
大規(guī)模集成電路設(shè)計專家，10多年超大規(guī)模電路SOC芯片設(shè)計和版圖設(shè)計經(jīng)驗，參與過DSP、GPU、DTV、WIFI、手機芯片、物聯(lián)網(wǎng)芯片等芯片的研發(fā)。精通CMOS工藝流程、版圖設(shè)計和布局布線，精通SOC芯片
設(shè)計和版圖設(shè)計的各種EDA工具（如：DC/Prime Time/Encounter/Virtuoso/Calibre/Dracula/Assura），具有豐富的SOC芯片設(shè)計、驗證、DFT、PD、流片經(jīng)驗。
熟練掌握版圖設(shè)計規(guī)則并進行驗證及修改；熟練掌握Unix/Linux操作系統(tǒng)；熟悉CMOS設(shè)計規(guī)則、物理設(shè)計以及芯片的生產(chǎn)流程與封裝。
【王老師】
資深I(lǐng)C工程師，十幾年集成電路IC設(shè)計經(jīng)驗，精通chip的規(guī)劃、數(shù)字layout、analog layout和特殊電路layout。先后主持和參與了近三百顆CHIP的設(shè)計與版圖Layout工作,含MCU芯片、DSP芯片、LED芯片、視頻芯片、GPU芯片、通信芯片、LCD芯片、網(wǎng)絡(luò)芯片、手機芯片等等。
從事過DAC、ADC、RF、OP、PLL、PLA、LNA、ESD、ROM、RAM等多種制程analog&digital的電路IC設(shè)計，
熟練掌握1.8V，3.3V,5V,18V,25V，40V等各種高低壓混合電路的IC設(shè)計。
【張老師】
從事數(shù)字集成電路設(shè)計10余年，精通CMOS工藝流程、版圖設(shè)計和布局布線，精通VERILOG,VHDL語言，
擅長芯片前端設(shè)計和復(fù)雜項目實施的規(guī)劃管理，其領(lǐng)導(dǎo)開發(fā)的芯片已成功應(yīng)用于數(shù)個國際知名芯片廠商之產(chǎn)品中。豐富的芯片開發(fā)經(jīng)驗，對于現(xiàn)今主流工藝下的同步數(shù)字芯片設(shè)計技術(shù)和流程有良好把握。長期專注于內(nèi)存控制器等產(chǎn)品的研發(fā)，擁有數(shù)顆規(guī)模超過百萬門的數(shù)字芯片成功流片經(jīng)驗.
★更多師資力量請見曙海師資團隊。 |
| 實戰(zhàn)演練使用的工具和實驗介紹 |
◆ 本課程實戰(zhàn)演練使用Synopsys公司的DC,PT等工具，
和Cadence公司的Encounter,Virtuoso等工具，多工具聯(lián)合從頭至尾強化練習(xí)整個芯片的生成過程，強調(diào)實戰(zhàn)，實戰(zhàn)，還是實戰(zhàn)！
◆ 免費、無保留贈送，教學(xué)過程中使用的Synopsys公司和Cadence公司的全套工具和安裝方法，而且還贈送已經(jīng)在VMware Linux下安裝好的Synopsys公司和Cadence公司的全套工具（這套工具非常珍貴，費了老師很多心血才全部安裝好），讓您隨時隨地，打開電腦就能進行芯片的設(shè)計和練習(xí)！
◆ 贈送每個工具用到的流片廠工藝庫和技術(shù)文件。
◆ 企業(yè)化項目管理方案。
◆ 專屬助教一對一服務(wù)，及時回答學(xué)員學(xué)習(xí)過程中遇到的難題。
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數(shù)字集成電路前端設(shè)計培訓(xùn)班 |
1. Unix/Linux操作系統(tǒng)使用
2. 文本編輯器VIM
3. 數(shù)字電路技術(shù)基礎(chǔ)
4. 半導(dǎo)體電路和工藝基礎(chǔ)
5. 數(shù)字邏輯設(shè)計
6. 數(shù)字集成電路設(shè)計流程
7. Verilog HDL硬件描述語言和電路設(shè)計技術(shù)與技巧
8. 電路驗證技術(shù)以及Modelsim、VCS等驗證工具的使用
9. ASIC和SOC設(shè)計導(dǎo)論
10. FPGA設(shè)計和驗證初步
11.數(shù)字電路驗證
1)驗證平臺的建立
2）功能測試
12.設(shè)計綜合（synthesys）
13，Verilog編程思想
1）Verilog語言
2）Verilog編程思想
3）Verilog LCD編程案例
4）Synopsys VCS芯片邏輯驗證
14.靜態(tài)時序分析
15.項目實戰(zhàn)：
1）RTL coding
2)狀態(tài)機中斷處理
3）testbench 建立
4）Testcase創(chuàng)建
16.項目實戰(zhàn)二：
1）RTL coding
2)通訊數(shù)據(jù)協(xié)議E1
3)異步電路處理
4）算法
5）CPU控制
6）Testbench建立和testcase
18.數(shù)字前端全流程設(shè)計工具
19.相關(guān)工藝庫文件IC技術(shù)
20. 邏輯綜合初步以及SYNOPSYS DC等綜合工具的使用
重點講解數(shù)字電路設(shè)計的綜合技術(shù)的基本概念，綜合流程和工程經(jīng)驗，使學(xué)員掌握基于synopsys DC的綜合技巧。
內(nèi)容包括：
綜合機理的分析；組合電路和時序電路實現(xiàn)規(guī)則和實例分析；基于tcl綜合的流程,優(yōu)化處理和調(diào)試技術(shù)；綜合處理與后端流程的聯(lián)系；可綜合代碼技術(shù)；需深入研究的內(nèi)容；LPC 接口模塊綜合實驗
ASIC 靜態(tài)時序分析技術(shù)
介紹靜態(tài)時序分析技術(shù)；使學(xué)員掌握基于Synopsysy PrimeTime的靜態(tài)時序分析技術(shù)。
內(nèi)容包括：
背景分析；電路時序分析的基礎(chǔ)內(nèi)容；工具的使用；靜態(tài)時序分析模式選擇；注意事項及需深入研究的內(nèi)容；LPC接口模塊實驗
21、VLSI系統(tǒng)的設(shè)計方法學(xué)。時序分析法、基于Snopsys EDA Tools Chain實現(xiàn)的完整ASIC設(shè)計流程、數(shù)字設(shè)計庫的介紹，分析、創(chuàng)建，及使用。
22、編碼及仿真技巧。編碼規(guī)范、RTL驗證仿真技術(shù)、門級仿真技術(shù)。
23、ASIC設(shè)計流程的高級話題。例如跨時鐘域信號的處理，同步撫慰電路設(shè)計及相關(guān)流程處理等設(shè)計技巧。
24. 項目設(shè)計實訓(xùn):
大型實訓(xùn)項目一.Sigma-Delta小數(shù)分頻器設(shè)計、驗證與綜合
大型實訓(xùn)項目二.DVI編碼器/解碼器設(shè)計、驗證與綜合
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