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計(jì)算機(jī)組成原理培訓(xùn)

第1周 從0到1

0.1 課程計(jì)劃

0.2 課程研究范圍

1.1 控制復(fù)雜性的藝術(shù)

1.2 數(shù)制系統(tǒng)

第一周測(cè)驗(yàn)題

第1-14周 硬件描述語言（選學(xué)）

4.1 HDL應(yīng)用背景知識(shí)

4.2 HDL基礎(chǔ)

4.3 深入HDL

4.4 HDL測(cè)試程序

第4單元 測(cè)驗(yàn)

第2周 二進(jìn)制

1.3 信息表示

1.4 邏輯代數(shù)基礎(chǔ)

1.5 數(shù)字抽象

1.6 功耗問題

第二周測(cè)驗(yàn)題

第1單元測(cè)驗(yàn)

組合邏輯設(shè)計(jì)

2.1 組合邏輯基礎(chǔ)

2.2 布爾代數(shù)

2.3 用卡諾圖化簡(jiǎn)邏輯

第2單元測(cè)驗(yàn)

時(shí)序邏輯設(shè)計(jì)

3.5 設(shè)計(jì)乘法器

3.1 具有記憶功能的電路

3.2 同步時(shí)序邏輯設(shè)計(jì)

3.3 時(shí)序邏輯電路的時(shí)序

3.4 并行

第四周測(cè)驗(yàn)題

第五周測(cè)驗(yàn)題

第3單元 測(cè)驗(yàn)

第6周 常見數(shù)字模塊

5.1 加法器

5.2 常見數(shù)字模塊

5.3 單精度定點(diǎn)乘法器

5.4 單精度定點(diǎn)除法器

復(fù)雜邏輯模塊

5.5 浮點(diǎn)數(shù)

5.6 存儲(chǔ)器

5.7 邏輯陣列

第七周測(cè)驗(yàn)題

第5單元 測(cè)驗(yàn)

體系結(jié)構(gòu)

6.1 體系結(jié)構(gòu)

6.2 存儲(chǔ)器大小端問題

6.3 MIPS匯編語言

6.4 MIPS機(jī)器語言

6.5 使用MIPS匯編語言編程

6.6 MIPS尋址方式

6.7 生成可執(zhí)行文件

第6單元 測(cè)驗(yàn)

7.1 性能分析

7.2 單周期處理器

7.3 多周期處理器

7.4 流水線處理器沖突問題

第7單元 測(cè)驗(yàn)

第12-13周 存儲(chǔ)器系統(tǒng)

8.1 多層次的儲(chǔ)存體系結(jié)構(gòu)

8.2 存儲(chǔ)器系統(tǒng)性能分析

8.3 Cache

8.4 虛擬存儲(chǔ)器